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研究数字音频无线传输中的前向纠错(FEC)算法的设计及实现，对前向纠错中的主要功能模块，如RS编解码、交织器与解交织器等给出基本算法及基于现场可编程门阵列(FPGA)和硬件描述语言的解决方案。选用硬件描述语言VerilogHDL，在开发工具QuartusII4．2中完成软核的综合、布局布线和汇编，在Modelsim中进行时序仿真验证，最终下栽到开发板中进行电路验证及测试。，大小：9.04 MB
研究数字音频无线传输中的前向纠错(FEC)算法的设计及实现，对前向纠错中的主要功能模块，如RS编解码、交织器与解交织器等给出基本算法及基于现场可编程门阵列(FPGA)和硬件描述语言的解决方案。选用硬件描述语言VerilogHDL，在开发工具QuartusII4．2中完成软核的综合、布局布线和汇编，在Modelsim中进行时序仿真验证，最终下栽到开发板中进行电路验证及测试。，大小：9.04 MB