好东西与大家分享。虽然翻译者的中文水平较差，但仍然有一定的参考价值。
IPC-SM-782 Revision A - August 1993
(本文是该标准的3.6~3.6.2.3的翻译稿，其后的内容为3.6.3通路孔位置指南)
3.6 设计规则
在一个设计的元件选择阶段，应该就有关超出本文件范围的任何元件咨询一下制造工程部门。
印制板的设计原则是现时测试与制造能力的一个陈述。超出或改变这些能力都要求在包括制造、工程和测试技术在内的过程中所有参与者的共同合作。
在设计中较早地涉及测试与制造有助于将高质量的产品迅速地投入生产。
3.6.1 元件间隔
3.6.1.1 元件考虑
现在已经讨论过的焊盘结构设计的信息对于表面贴装装配的可靠性是重要的。可是设计者不应该忽视SMT装配的可制造性、可测试性和可修理性。最小的封装元件之间的间隔要求满足所有这些制造要求。最大的封装元件之间的间隔是没有限制的；越大越好。有些设计要求，表面贴装元件尽可能地靠近。基于经验，图3-8中所显示的例子都满足可制造性的要求。
在相邻元件之间的焊盘对焊盘的间隔应该是1.25mm[0.050"]的沿印制板所有边缘空隔，如果板是脱离连接器测试的；或者最少2.5mm[0.100"]，如果测试使用真空密封。这里规定的要求是推荐的最小值，除了导体几何公差。
3.6.1.2 波峰焊接元件的方向
所有的有极性的表面贴装元件在可能的时候都要以相同的方向放置。在任何第二面要用波峰焊接的印制板装配上，在该面的元件首选的方向如图3-9所示。使用这个首选方向是要使装配在退出焊锡波峰时得到的焊点质量最佳。
· 所有无源元件要相互平行
· 所有SOIC要垂直于无源元件的长轴
· SOIC和无源元件的较长轴要互相垂直
· 无源元件的长轴要垂直于板沿着波峰焊接机传送带的运动方向
3.6.1.3 元件贴装
类型相似的元件应该以相同的方向排列在板上，使得元件的贴装、检查和焊接更容易。还有，相似的元件类型应该尽可能接地在一起，使网表或连通性和电路性能要求最终推动贴装。请见图3-10。例如，在内存板上，所有的内存芯片都贴放在一个清晰界定的矩阵内，所有元件的第一脚在同一个方向。这是在逻辑设计上实施的一个很好的设计方法，在逻辑设计中有许多在每个封装上有不同逻辑功能的相似元件类型。在另一方面，模拟设计经常要求大量的各种元件类型，使得将类似的元件集中在一起颇为困难。不管是否设计为内存的、一般逻辑的、或者模拟的，都推荐所有元件方向为第一脚方向相同。
3.6.1.4 基于栅格的元件放置
SMT元件贴装与方向通常比通孔技术(THT)的印制板更加困难，有两个原因：更高的元件密度，和将元件放在板的两面的能力。对于THT设计，元件是以2.54mm[0.100"]的中心间距放置的，假设1.3mm[0.065"]的焊盘，焊盘之间的间隔为1.2mm。可是，在高密度SMT设计中，焊盘之间的间隔经常较小，小至0.63mm[0.025"]或更小。基于栅格的元件放置(0.100"的栅格是THT的标准)被大量与现在可购买到的SMT元件封装有关的焊盘尺寸所复杂化了。
今天所完成的大多数SMT设计已经放弃了THT板的标准栅格放置规则。这最终造成元件的随机放置，通路孔甚至更加随机地在板上放置。
由于随机元件放置所产生的两个问题，一是失去了均匀的基于栅格的测试节点的可访问性，二是失去了在所有层面上逻辑的、可预测的路由通道（可能使板层数增加）。除此之外在IEC出版物IEC97中确认的已接受的国际栅格对于新的设计应该为0.5mm，进一步分割为0.05mm。对这个问题的一个解决方法是，用所有的用于测试、路由和翻修点的、以0.05mm中心（或更大，基于设计）连接到通路孔的元件焊盘建立CAD数据库。然后，当在CAD系统上作元件的放置时，简单地放置元件以使得在焊盘之间有最少0.5mm的间隔，然后将正在放置的元件的通路孔跳出到下一个1.0mm的栅格点。以这个方法，所有元件应该有介于0.4mm~0.6mm（或平均05mm）的焊盘之间的间隔。从装配的角度看，处理元件形心在1.0mm栅格上的、板上所有焊盘之间的间隔在两个方向上大约相等的PCB较为容易。
3.6.1.5 单面板与双面板的比较
单面与双面这两个术语说的是在表面贴装出现之前，在一块印制电路板上的一个或两个导体层。可是，现在，单面的术语指的是元件贴装在一个面上（第一类型的装配）。双面指的是元件贴装在板的两面（第二类型的装配）。已经观察到许多SMT设计者，特别是新手，太急于将元件放置在板的第二面，迫使装配工艺过程执行两次而不是一次。设计者应该集中考虑尽可能地将所有元件放在板的主面上，并且不产生元件间隔的冲突。其结果是较低的装配成本。如果一定要求双面贴装，那么基于栅格的元件放置，虽然更困难，但对于精确的最终元件贴装、电路的可布线性、和可测试性是甚至更加关键的。使用传统SMT设计规则的双面板经常要求双面的，或者蛤壳式的测试夹具，其成本为单面测试夹具的3~5倍。人们知道，基于栅格的元件贴装改进节点的可访问性，以及消除双面测试的需要。
3.6.1.6 焊锡模板设计
焊锡模板是主要的媒介物，通过它将锡膏施用到SMT印制板上。使用它，可精确地控制锡膏沉淀的准确位置和体积。模板的布孔图通常由板外层的元件贴装焊盘组成，板面上的其它所有电路都去掉了。模板上的开孔应该是板上所有元件焊盘的相同大小。密间距(fine pitch)的元件例外。密间距的元件使用相同的宽度，但是开孔的长度缩短1/3，并对中。印制板装配商可以自己选择，在制造模板之前改变模板开孔的尺寸，以改变沉积在焊盘上锡膏的量。
3.6.1.7 用于清洁的元件离地高度
用于清洁的最小元件离地高度是基于该元件的对角线距离。这个尺寸表示如果小心可能集聚污垢的元件表面积。表3-7显示推荐的元件离板距离的相互关系。
元件对角线 元件表面积 元件离地高度
<= 50 mm <= 2500 mm2 >= 0.5 mm
<= 25 mm <= 625 mm2 >= 0.3 mm
<= 12 mm <= 144 mm2 >= 0.2 mm
<= 6 mm <= 36 mm2 >= 0.1 mm
<= 3 mm <= 9 mm2 >= 0.05 mm
表3-7、元件的离地高度(Stand off)
如果不能达到最小的离地高度，对元件下的适当清洁是不可能的。这种情况下推荐使用免洗助焊剂。
3.6.1.8 基准点标记(Fiducial Marks)
基准点标记是一个在电路布线图的同一个工艺中产生的印制图特征。基准点和电路布线图必须在同一个步骤中腐蚀出来。
基准点标记为装配工艺中的所有步骤提供共同的可测量点。这允许装配使用的每个设备精确地定位电路图案。有两种类型的基准点标记，它们是：
A. 全局基准点(Global Fiducials)
基准点标记用于在单块板上定位所有电路特征的位置。当一个多重图形电路以组合板(panel)的形式处理时，全局基准点叫做组合板基准点。（见图3-11）
B. 局部基准点(Local Fiducials)
要求至少两个全局基准点标记来纠正平移偏移（X与Y位置）和旋转偏移（θ位置）。这些点在电路板或组合板上应该位于对角线的相对位置，并尽可能地距离分开。
要求至少两个局部基准点标记来纠正平移偏移（X与Y位置）和旋转偏移（θ位置）。这可以是两个位于焊盘图案范围内对角线相对的两个标记。
如果空间有限，则至少可用一个基准点来纠正平移偏差（X与Y位置）。单个基准点应该位于焊盘图案的范围内，作为中心参考点。
局部、全局或组合板基准点的最小尺寸是1.0mm。一些公司已经为组合板基准点选用较大的基准点（达到1.5mm）。保持所有的基准点为同一尺寸是个很好的方法。
3.6.1.9 基准点标记设计规格 表面贴装设备制造商协会(SMEMA)已经将基准点的设计原则标准化。这些原则得到IPC的支持，由下列事项组成：
A. 形状
B. 尺寸
基准点标记最小的直径为1mm[0.040"]。最大直径是3mm[0.120"]。基准点标记不应该在同一块印制板上尺寸变化超过25微米[0.001"]。
C. 空旷度(clearance)
在基准点标记周围，应该有一块没有其它电路特征或标记的空旷面积。空旷区的尺寸要等于标记的半径。标记周围首选的空地等于标记的直径。（见图3-14）